研究数字电路，任何复杂的数字逻辑都是基于功能模块的拼接和基础模块的设计。
基础模块的设计就会涉及到状态方程和状态图以及其他特定的设计方法。
前者对于FPGA开发来讲，会有一些成熟的IP核模块，高度定制化的功能模块靠自己设计。
也会有状态方程，对Verilog或者VHDL以及一些systemC之类的高级设计语言，
就是用^&|等最基本逻辑组合实现的组合逻辑，以及多个always块形成的触发、寄存机制。
如果LZ对数字电路了解足够深入，那么转移到FPGA上是不费吹灰之力的。
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其实写verilog或者VHDL也是画电路图。
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在某些IDE上是可以用电路图开发的，当然也可以配合硬件描述代码混合开发。
比如说，厂商提供了IP核，在IDE上就显示为一个模块，有输入输出端口。你连接不同的现成模块相当于绘制电路图，最后编译烧录就行。
你也可以用硬件描述语言通过行为级描述定义自己的模块，直接用硬件描述语言描述所有的模块及其连接关系然后编译烧录，或者先生成有关你自己定义模块在电路图上，然后用走线连接不同的模块最终完成开发也行。
FPGA编写的是电路结构，你可以纯代码编辑，也可以图示化的编程，跟画电路图差不多但也有区别。
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楼主要是有耐心，用altera的quartus环境可以试试画电路图连接IP。
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引用0x00000000发表于4楼的内容在某些IDE上是可以用电路图开发的，当然也可以配合硬件描述代码混合开发。比如说，厂商提供了IP核，在...
这样就方便很多了，模块化简化了不少，不知道哪个软件支持电路图开发？
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简单的逻辑可以原理图直接画 上一点规模的用HDL语言 但是和c程序不同的是 写硬描述一定要有原理图的思维
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一般大脑里要先有了原理图或者小功能模块的逻辑结构 才用HDL进行描述
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